CN100511594C - 氧化铪铝介质薄膜 - Google Patents

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Abstract

一种含HfAlO3的介质薄膜和一种制作这一类介质薄膜的方法生产出了一种可靠的栅介质，它具有的等效氧化物厚度比采用SiO2可能得到的要薄。栅介质通过采用铪顺序和铝顺序的原子层沉积法形成。铪顺序采用了HfCl4和水蒸气。铝顺序采用了或者是三甲基铝，Al(CH3)3，或者DMEAA，一种铝烷(AlH3)和二甲基乙胺[N(CH3)2(C2H5)]的加成物，加上蒸馏水蒸气。这些含HfAlO3薄膜的栅介质均是热力稳定的，以致这HfAlO3薄膜在加工过程中与硅衬底或其它结构有极微弱的反应。

Description

氧化铪铝介质薄膜
相关申请
本申请与以下的，共同未决的，共同转让的申请有关，这些有关申请在此引入作参考：
美国申请号10/137499，代理卷号1303.050US1标题：“用作栅介质的原子层沉积LaAIO3薄膜”，
美国申请号10/137058，代理卷号303.802 US1标题：“原子层沉积和转化”，
美国申请号10/137168，代理卷号1303.048US1标题：“利用ULSI栅原子层沉积法形成的，用作栅介质层的AlOx原子层”和
美国申请号09/797324，代理卷号303.717US1标题：“均匀化学气相沉积法所采用的方法，系统，和设备”。
发明领域
本发明涉及半导体器件和器件的制作。特别是，本发明涉及晶体管器件的栅介质层和它们的制作方法。
发明背景
半导体器件制造业有着驱使其需要改善速率性能，改善其低静态(静止态)功率要求和适应对硅基微电子产品的各式各样的电源要求及输出电压要求等方面的市场需求。尤其是在晶体管制作中，有着面临要求减小器件例如晶体管尺寸的持续压力。最终的目的是制作出越来越小的和更可靠的集成电路(IC)供在例如信息处理机芯片，移动电话机或存储器例如DRAM等产品中使用。较小的器件经常是由蓄电池供电，故也面临要求减小蓄电池尺寸和延长电池充电之间的时间的压力的处境。这促使工业界不仅要设计更小的晶体管而且要将它们设计成能在较低的电源下可靠工作。
目前，半导体工业有赖于减小或按比例缩小基本器件，主要是硅基金属氧化物半导体场效应晶体管(MOSFET)，的尺寸的能力。这一类晶体管的常见构型示于图1。虽然以下的讨论应用了图1来阐明利用现有技术制造的晶体管，但本领域的每一位技术人员都承认可以将本发明引入图1所示晶体管中，以制成与本发明相应的新型晶体管。晶体管100用通常为硅的衬底110制成，但也可以用其它的半导体材料制成。晶体管100具有第一源极/漏极区120和第二源极/漏极区130。主体区132位于第一源极/漏极区和第二源极/漏极区之间，此处的主体区132定义了具有沟道长度134的晶体管沟道。栅介质，或栅氧化物140位于主体区132内，而栅150位于栅介质的上方。虽然栅介质可以是由氧化物之外的材料形成，但栅介质通常是氧化物，并常称为栅氧化物。栅可以用多晶硅制成，或用其它导电材料制成例如可以使用金属。
为了制造尺寸更小的和能在较低电源下可靠地工作的晶体管，一个重要的设计标准是栅介质140。形成栅介质的主角是二氧化硅SiO2。热生长非晶形SiO2层是一种电和热力稳定材料，在SiO2层与底层Si的界面处形成了高质量的界面以及上佳的电绝缘性能。在典型的加工过程中，在Si上使用SiO2会造成缺陷电荷密度，其量级为1010/cm2，中间带隙界面态密度约为1010/cm2eV，和击穿电压在15MV/cm范围内。就这样的质量而言，没有明显看出需要使用除SiO2之外的材料，但是栅介质的定标的提高和其它要求会产生需要寻找用作栅介质的其它介质材料。
所需要的是这样一种替代介质材料，它可用来形成具有较之SiO2有高介电常数的栅介质和相对于硅是热力稳定的，以致在硅层上形成介质时不会导致有SiO2形成或使来自底层硅层的材料例如掺杂剂扩散到栅介质中。
发明概述
在本发明所讲授的实施方案中论述了解决以上所述问题的方法。在一种实施方案中，一种在晶体管主体区上形成栅介质的方法包括在晶体管主体区上进行含HfAlO3非晶形薄膜的原子层沉积(ALD)。形成HfAlO3薄膜所采用的ALD方法是将含铪前体脉冲输入装有衬底的反应室，将第一含氧前体脉冲输入反应室，将含铝前体脉冲输入反应室，最后将第二含氧前体脉冲输入反应室。每种前体根据所选定的时间周期被脉冲输入反应室。脉冲输送每种前体所用时间的长短根据所采用的前体选定。在每次脉冲输送前体之间将剩余的前体和反应的副产物从反应室中除去。HfAlO3薄膜的厚度通过重复进行脉冲输送含铪前体，第一含氧前体，含铝前体和第二含氧前体的循环次数来控制，直至形成要求的厚度。
有利之处是，由HfAlO3薄膜形成的栅介质具有比二氧化硅要大的介电常数，相对地小的漏电电流和对硅基衬底有良好的稳定性。本发明所讲授的各种实施方案包含形成各种晶体管，存储器，和具有含HfAlO3的介质层的电子系统。
其它实施方案包括适用于晶体管，存储器，和具有HfAlO3薄膜的介质栅的电子系统的各种结构。与具有同样实体厚度的氧化硅栅相比，这类介质栅具有显著地薄的等效氧化物厚度。另一方面，这类介质栅较之具有同样等效氧化物厚度的氧化硅栅具有显著地厚的实体厚度。
本发明的这些和其它的实施方案，见解，优点和特点部分地陈述于随后的叙述中，和对于本领域的那些技术人员来说，部分地通过参阅下述本发明的叙述和参阅附图或通过本发明的实践而变得显而易见了。本发明的这些见解，优点和特点借助于尤其是在后面所附的权利要求书中所指出的装置，程序和组合得以实现和达到。
附图简述
图1描绘了晶体管的常见构型。
图2A描绘了一种本发明所讲授的加工HfAlO3薄膜用的原子层沉积系统的实施方案。
图2B描绘了一种本发明所讲授的加工HfAlO3薄膜用的原子层沉积室的气体分配装置的实施方案。
图3说明了一种本发明所讲授的HfAlO3薄膜加工方法的实施方案所采用的单元工艺流程图。
图4描绘了一种本发明所讲授的可以用来制作一种晶体管构型的实施方案。
图5说明了引入本发明所讲授的器件的个人用计算机的实施方案的透视图。
图6说明了引入本发明所讲授的器件的中央处理机的实施方案的示意图。
图7说明了本发明所讲授的DRAM存储器的实施方案的示意图。
优选实施方案详述
在本发明的以下详述中，参照了形成详述一部分的附图，并为了说明，这些附图显示了可以实施本发明的具体的实施方案。对这些实施方案所作的详细陈述，足以使本领域的那些技术人员能够实施本明。可以应用其它的实施方案并可在不超越本发明的范围的情况下进行结构，逻辑和电学的更改。
在以下叙述中使用的术语晶片和衬底包括任何具有外露面的结构，以便利用外露面形成本发明的集成电路(IC)结构。术语衬底应理解成包括半导体晶片。术语衬底也用来指加工过程中的半导体结构，并可以包括在其上已制成的其它层。晶片和衬底二者均包括掺杂和非掺杂的半导体，由基底半导体或绝缘体支承的外延半导体层，以及本领域的技术人员熟知的其它半导体结构。术语导体应理解成包括半导体，而术语绝缘体或介质被定义为包括导电性比称为导体的材料要低些的任何材料。
本申请中所采用的术语“水平”被定义为平行于晶片或衬底的普通的平面或表面，与晶片或衬底的取向无关。术语“垂直”指的是其方向与上面所定义的水平相垂直。以位于晶片或衬底的上表面上的普通平面或表面为基准来定义表示位置的介词，例如“在上面”，“侧面”(如在侧壁上)，“高于”，“低于”，“在上方”和“在下面”，与晶片或衬底的取向无关。所以，以下的详述并不作出限制的含义，而本发明的范围仅由附于后面的权利要求书，以及与权利要求书所给予的范围等同的全范围来定义。
图1的栅介质140，当其运行于晶体管中时，既有实体栅介质厚度又有等效氧化物厚度(teq)。等效氧化物厚度量化了以典型的实体厚度表示的栅介质140的电气性能例如电容。teq被定义为要求其具有和已知介质同样的电容密度的一种理论上的SiO2层的厚度，而不考虑漏电电流和可靠性这些方面的问题。
沉积在Si表面上作为栅介质的厚度t的SiO2层还将有一个大于它的厚度t的teq。这teq是由在其上沉积了SiO2的表面沟道内的电容引起的，这要归因于耗尽/反型区的形成，。这耗尽/反型区可导致使teq比SiO2层的厚度t大3～6埃
Figure C03817714D00101
于是，总有一天，在半导体工业驱使将栅介质等效氧化物厚度按比例缩小到低于
Figure C03817714D00102
的情况下，用作栅介质的SiO2层的实体厚度要求大概必须是大约
Figure C03817714D00103
对于SiO2的额外要求取决于和SiO2栅介质一起使用的栅电极。使用常规的多晶硅栅会导致SiO2层的teq额外增加。这额外增加的厚度可通过采用金属栅电极而消除，可是，金属栅目前尚未用于互补金属氧化物半导体场效应晶体管(CMOS)工艺中。因此，未来的器件将被设计为SiO2栅介质层的实体厚度约
Figure C03817714D00104
或更小。对SiO2氧化层如此小的厚度要求引起了额外的一些问题。
二氧化硅用作栅介质，部分地是由于它在SiO2-Si基结构中的电绝缘性能。这种电绝缘是由于SiO2的相对大的带隙(8.9eV)使它成为一种没有导电性的好的绝缘体。显著减小它的带隙会排除它作为一种栅介质的材料。当SiO2层的厚度降低时，在这厚度内的原子层层数或这种材料的单层层数将下降。在一定的厚度下，单层层数将少到足以使SiO2层不能象在较厚的或整体层中那样具有完整的原子排列。较之整体结构而言，不完全构造的结果是，只有一层或二层单层的薄SiO2层将不能形成全带隙。在SiO2栅介质中不是全带隙会在底层Si沟道和上层多晶硅栅之间造成有效短路。这不良特性对可以按比例缩小的SiO2层的实体厚度规定了限制值。由于这单层效应，这最小厚度被认为是约。所以，对于要求teq小于约
Figure C03817714D0010133038QIETU
的未来的器件来说，必需考虑除SiO2以外别的介质用作栅介质。
对于用作栅介质的典型介质层，其电容根据适用于平行板电容的公式确定：C＝K∈oA/t，式中K是介电常数，∈o是自由空间的电容率，A是电容器的面积，和t是这介质的厚度。对于给定电容的将SiO2的介电常数，Kox＝3.9，与teq结合的某种材料的厚度t与teq的关系如下
t＝(K/Kox)teq＝(K/3.9)teq
于是，介电常数大于SiO2的介电常数3.9的材料，其具有的实体厚度，当提供了所要求的等效氧化物厚度时，将显著地大于所要求的teq。例如，具有介电常数10的替代介质材料可以具有约
Figure C03817714D0010133028QIETU
的厚度，便可使teq为
Figure C03817714D00111
不计及任何耗尽/反型层效应。于是，通过采用具有介电常数高于SiO2的介质材料就能实现降低晶体管的等效氧化物厚度。
为了获得较低的晶体管工作电压和较小的晶体管尺寸而所需的较薄的等效氧化物厚度可以利用很多种材料来实现，但额外的制作要求使确定替代SiO2的合适的置换材料变得困难了。微电子工业目前的观点仍然是赞成Si基器件。这就要求采用的栅介质要能生长在硅衬底或硅层上，而这就对取代的介质材料设置了大量的限制。介质在硅层上形成的过程中，除了所要求的介质之外，还存在有可能形成一小层SiO2的可能性。结果实际上是一种由二层彼此平行的子层组成的介质层和在其上形成该介质的硅层。在这种情况下，最终的电容是二个串联介质的电容。因此，介质层的teq是SiO2层的厚度与所形成的介质的厚度乘以系数之和，写成
teq＝tSiO2+(Kox/K)t
因此，如果在此过程中形成了SiO2层，那么teq再次受SiO2层的限制。即使是在硅层和要求的介质之间有防止SiO2层形成的阻挡层，teq仍会受具有最小介电常数的那层的限制。可是，不管是采用了具有高介电常数的单层介质层还是采用了介电常数比SiO2高的阻挡层，与硅层面接的层必须具有高质量的界面，以保持高的沟道载流子迁移率。
G.D.Wilk等人的最新一篇论文发表在应用物理杂志第89卷10期第5243～5275页(2001)上，该论文讨论了用作栅介质的高介质材料的材料性能。公开的资料之一是Al2O3作为SiO2的置换材料的适用性。公开的Al2O3具有用作栅介质的良好的性能，例如大带隙，直至高温在Si上仍具有热力稳定性，和非晶形结构。此外，Wilk公开了在硅上形成Al2O3层不会导致出现SiO2界面层。可是，Al2O3的介电常数仅为9，其一些薄层可能具有的介电常数为约8～约10。虽然Al2O3介电常数比SiO2有改进，但仍希望栅介质采用更高的介电常数。Wilk所论及的其它介质及其性能如下
 
材料 介电常数(K)      带隙Eg(Ev)   晶体结构
SiO<sub>2</sub> 3.9 8.9 非晶
Si<sub>3</sub>N<sub>4</sub> 7 5.1 非晶
Al<sub>2</sub>O<sub>3</sub> 9 8.7 非晶
Y<sub>2</sub>O<sub>3</sub> 15 5.6 立方
La<sub>2</sub>O<sub>3</sub> 30 4.3 六方，立方
Ta<sub>2</sub>O<sub>5</sub> 26 4.5 斜方
TiO<sub>2</sub> 80 3.5 四方(金红石，锐钛矿)
HfO<sub>2</sub> 25 5.7 单斜，四方，立方
ZrO<sub>2</sub> 25 7.8 单斜，四方，立方
使用SiO2作为栅介质的优点之一是形成的SiO2层是一种非晶形的栅介质。栅介质具有非晶形结构是有利的，因为在多晶形栅介质中的晶界提供高的漏电路径。另外，在整个多晶形栅介质中晶粒尺寸和取向的变化可能引起该薄膜的介电常数发生变化。上述材料的性能包括结构都是针对呈整体状态的材料的。具有介电常数高于SiO2这一优点的材料也有呈结晶形态，至少呈整体构型这一缺点。用来替代SiO2作为栅介质的最佳选择材料是具有高介电常数的，能将它们制作成具有非晶形状态的薄层的那些材料。
在共同未决的，共同转让的美国专利申请：标题为“用作栅介质的原子层沉积LaALO3薄膜”代理卷号1303050 US1，序列号10/137499中公开了LaALO3作为SiO2的替换材料，在电子器件例如MOS晶体管中用来形成栅介质和其它介质薄膜。这份申请公开了，其中包括，应用原子层沉积法利用含镧源和含铝源在硅上形成LaALO3层。控制镧顺序沉积和铝顺序沉积便可形成这样一种栅介质，它是一种具有预定介电常数的组合物。
在本发明所讲授的某一种实施方案中，利用原子层沉积(ALD)法，也称为原子层外延(ALE)法，使HfAlO3层沉积在硅上。ALD作为化学气相沉积(CVD)的一种改进是在20世纪70年代初期开发出来的，所以也叫“交替脉冲型CVD”。在ALD中，将各种气体前体每次一种引导到放置在反应室(或反应釜)中的衬底表面上。这些气体前体的引进采用脉冲输送每种气体前体的方式。在各个脉冲之间用惰性气体吹洗反应室或抽空反应室。在第一个脉冲相中，在前体饱和地化学吸附在衬底表面的情况下，与衬底的化学反应发生了。随后利用惰性气体吹洗清除反应室中剩余前体。
第二脉冲相将另一种前体引至衬底上，在此发生所要求的薄膜的生长反应。在薄膜生长反应之后，从反应室中清除反应的副产物和剩余前体。在正确设计的流动式反应室内，凭借良好的前体化学性质，这些前体在衬底上积极地吸附和彼此发生反应，能在小于1秒钟的时间内进行一次ALD循环。典型地，前体的脉冲输送时间范围从约0.5秒到约2至3秒。
在ALD中，有利之处是所有反应和净化阶段处于饱和状态使生长受到自身限制。这种自身限制式生长导致大面积的均匀性和共形性，这对于诸如平板衬底，深沟槽这类情况，并在多孔硅，和高表面面积的二氧化硅以及氧化铝粉末的加工中有着重要的应用价值。有意义的是，ALD提供了通过控制生长循环次数来控制薄膜厚度的一种直截了当的简单的方法。
最初，开发ALD是为了制造场致发光显示器中所需的发光薄膜和介质薄膜。经多方努力已将ALD应用于掺杂硫化锌和碱土金属硫化物的薄膜的生长。另外，已研究出将ALD应用于各种各样的外延II-V和II-VI薄膜的生长，非外延的结晶或非晶形的氧化物和氮化物薄膜的生长，和这些薄膜的多层结构的形成。还有值得感兴趣的是关于硅和锗薄膜的ALD生长，但是由于困难的前体化学，故这一努力不十分成功。
这些前体可以是气体，液体或固体。但是，液体或固体前体必须是易发挥的。蒸气压力必须足够高以便能有效地输送质量。还有，固体前体和某些液体前体必需在反应室内加以加热并通过受热式管路将其引至衬底上。必需的蒸气压力务必在低于衬底温度的温度下达到，以避免前体凝结在衬底上。由于ALD的这种自身限制生长机理，对固体前体可以采用比较低的蒸气压力，虽然在此过程中由于它们的表面面积改变，蒸发速度可能有点变化。
对用于ALD的前体有一些其它要求。这类前体在衬底温度下必须是热稳定的，因为它们的分解会破坏表面控制，并从而破坏了基于前体在衬底表面上形成反应物的ALD方法的优点。当然，如果这种分解与ALD生长相比是缓慢的，则少量分解是可以允许的。
前体应该化学吸附在衬底表面上或与表面起化学反应，虽然前体和表面之间相互作用以及吸附的机理对于不同的前体是不同的。衬底表面上的分子必须积极地与第二前体发生反应以便形成要求的固体薄膜。另外，前体不应该与薄膜发生反应而引起浸蚀，和前体不应该溶于薄膜中。在ALD中使用高活性前体与常规CVD的前体选用形成了对比。
在本反应中的副产物必须是气体，以便很容易地将其从反应室中排出，再者，这副产物不应该发生反应或吸附在表面上。
在一种实施方案中，采用以下程序使HfAlO3薄膜形成在放置于反应室内的衬底上，即将含铪前体脉冲输入反应室，随后脉冲输入第一含氧前体，然后将含铝前体脉冲输入反应室，接着将第二含氧前体脉冲输入反应室。在每次脉冲输送之间，将吹洗气体引入反应室。将含铪前体脉冲输入反应室，随后脉冲输送第一含氧前体，同时在每次脉冲输送之后接着进行吹洗便构成一个铪顺序。类似地，将含铝前体脉冲输入反应室，随后将第二含氧前体脉冲输入反应室，同时在每次脉冲输送之后接着进行吹洗便构成一个铝顺序。选择第一含氧前体取决于被脉冲输入反应室的含铪前体，同样，第二含氧前体取决于被脉冲输入反应室的含铝前体。另外，可以将不同的吹洗气体应用于铪顺序和铝顺序。此外，按照预定的周期逐一地对将每一种前体脉冲输入反应室加以控制，此处每种前体的预定周期根据前体的性质而不同。
这样选择前体，以致在进行了一个铪顺序之后接着进行一个铝顺序便完成一次HfAlO3层的ALD沉积循环。HfAlO3层的厚度取决于所采用的前体，脉冲输送的周期和工艺温度。通过重复进行若干次铪顺序和铝顺序循环来形成具有预定厚度的HfAlO3薄膜。一旦形成了具有要求厚度的HfAlO3薄膜，就对HfAlO3薄膜进行退火。
在本发明的某一实施方案中，前体气体被用来在晶体管主体上形成用作栅介质的HfAlO3薄膜。另一方面，固体或液体前体可用于恰当设计的反应室中。其它材料的ALD形成公开于共同未决的，共同转让的美国专利申请中，标题“原子层沉积和转化”代理卷号303.802US1，序列号10/137,058，和“利用VLS1栅原子层沉积法形成的，用作栅介质层的AlOx原子层”。代理卷号1303.048US1，系列号10/137,168。
图2A描述了本发明所讲授的加工HfAlO3薄膜用的原子层沉积系统的实施方案。所描述的部件是讨论本发明所必需的那些部件，以致本领域的那些技术人员无需过分的实验工作经验就可实践本发明。有关ALD反应室的进一步讨论可从在此引入作参考的，共同未决的，共同转让的美国专利申请：标题“均匀化学气相沉积所采用的方法，系统和装置”，代理卷号303.717US1，系列号09/797324中找得。在图2A中，衬底210被放置在ALD系统200的反应室220内。在反应室220内还放置了加热元件230，它和衬底210发生热耦合，以控制衬底的温度。气体分配装置240将前体气体引至衬底210。每一种前体气体来源于各自的气体源251～254，其流量分别由质量流量控制器256～259控制。气体源251～254或者通过储存气体状前体的方法或是通过提供用于蒸发固体或液体材料以形成所选的前体气体所需的场所和装置的方法来提供前体气体。
在ALD系统中还包括吹洗气体源261，262，其中每个分别与质量流量控制器266，267相耦合。气体源251～254和吹洗气体源261-262通过它们的质量流量控制器与公共输气管或导管270相耦合，这输气导管又与反应室220内的气体分配装置240相耦合。这输气导管270还通过质量流量控制器286与真空泵或排气泵281相耦合，以便在吹洗程序结束时从输气导管中除去剩余的前体气体，吹洗气体，和副产品气体。
真空泵或排气泵282与质量流量控制器287相耦合，以便在吹洗程序结束时从反应室220中除去剩余的前体气体，吹洗气体，和副产物气体。为了方便起见，本领域的那些技术人员熟知的控制器显示器，固定装置，温度传感器件，衬底操纵装置和必需的电气引线，在图2A上均未示出。
图2B描述了本发明所讲授的加工HfAlO3薄膜用的原子层沉积室的气体分配装置的实施方案。气体分配装置240包括气体分配部件242和气体进气管244。气体进气管244使气体分配部件242与图2A的输气导管270相耦合。气体分配部件242包括气体分配孔或出口246和气体分配管道248。在这示范性实施方案中，这些孔246基本上都是具有同样的直径为15～20微米的圆；气体分配管道248具有同样的宽度20～45微米。具有气体分配孔246的气体分配部件的表面249基本上是平面且平行于图2A的衬底210。但是，其它一些实施方案采用了其它的表面形式以及孔和管道的形状和尺寸。孔的分布和尺寸还可能影响沉积厚度，因而可以用来参与厚度控制。孔246通过气体分配管道248与气体进气管244相耦合。虽然ALD系统200很适宜于实践本发明，但市场上有售的其它ALD系统也可使用。
沉积薄膜所采用的反应室的应用，结构和基本运作，对于半导体制作领域的那些普通技术人员来说都是了解的。本发明可以在各种这样的反应室内得以实施无需过分的实验工作经验。此外，本领域的每个普通技术人员一阅读本公开内容就将会理解半导体制作领域中所必需的探测，测量和控制技术。
图3说明了本发明所讲授的HfAlO3薄膜加工方法的实施方案所采用的单元的流程图。本方法可利用图2A，B所示的原子层沉积系统得以实现。在程序块305内，制备衬底。用来形成晶体管的衬底典型地是硅或含硅材料。在其它实施方案中，可以采用锗，砷化镓，和蓝宝石上硅衬底。这制备方法包括在形成栅介质之前清洗衬底210和形成衬底的各层和各个区，例如金属氧化物半导体(MOS)晶体管的漏区和源区。正被加工的晶体管其各个区的形成顺序遵循着在MOS晶体管的制作中通常采用的，本领域的那些技术人员众所周知的典型顺序。在形成栅介质之前所包括的加工是在栅介质形成过程中要加以防护的衬底区的掩蔽，这正是MOS制作过程中典型地要进行的工作。在本实施方案中，非掩蔽的区包括晶体管的主体区，可是，本领域的每个技术人员将认识到其它的半导体器件结构可以利用本方法。另外，将处于准备加工状态的衬底210传送到进行ALD作业所采用的反应室220中的某一位置上。
在程序块310内，将含铪前体脉冲输入反应室220。尤其是，HfCl4用作源材料。HfCl4通过位于衬底210上方的气体分配装置240被脉冲输入反应室220。来自气体源251的HfCl4流量由质量流量控制器256加以控制。HfCl4源的气体温度范围为约130℃～约154℃。HfCl4与位于由衬底210的非遮掩面所定义的要求区中的衬底210的表面发生反应。
在程序块315内，将第一吹洗气体脉冲输入反应室220。尤其是，纯度大于99.99％的纯净氮气用作HfCl4的吹洗气体。来自吹洗气体源261的氮进入输气导管270的流量由质量流量控制器266控制。利用纯净氮气吹洗避免了前体脉冲和可能的气相反应发生重叠。吹洗之后，在程序块320内，将第一含氧前体脉冲输入反应室220。对于使用HfCl4作为前体的铪顺序，选择水蒸气作为前体起着氧化反应物的作用，以便在衬底210上形成氧化铪。来自气体源252的水蒸气，利用质量流量控制器257，以约0.5～约1.0mPam3/秒的流速，通过输气导管270，将其脉冲输入反应室220。水蒸气在衬底210的表面上发生积极的反应。
在脉冲输送氧化反应物水蒸气之后，在程序块325内，将第一吹洗气体喷射入反应室220。在HfCl4/水蒸气顺序中，在脉冲输送每种前体气体之后，利用纯氮气体吹洗反应室。利用吹洗气体，清除掉系统中的剩余前体气体和反应副产物，同时利用真空泵282，通过质量流量控制器287抽空反映器220，和利用真空泵281，通过质量流量控制器286抽空输气导管270。
在实施HfCl4/水蒸气顺序过程中，通过加热元件230和使用呈低压(250Pa)热壁构形的反应室一起使衬底温度保持为约350℃～约550℃。在其它的一些实施方案中，使衬底温度保持为约500℃～1000℃。HfCl4的脉冲输送时间在约1.0秒～2.0秒范围内。在脉冲输送HfCl4之后，继续进行包括吹洗脉冲，接着水蒸气脉冲，再接着吹洗脉冲在内的铪顺序。在一种实施方案中，进行吹洗脉冲，接着水蒸气脉冲，再接着吹洗脉冲共费时约2秒。在另一实施方案中，在脉冲输送HfCl4之后，在铪顺序中，每个脉冲有2秒的脉冲周期。
在程序块330内，将含铝前体脉冲输入反应室220。在一种实施方案中，在HfCl4/臭氧顺序之后，三甲基铝(TMA)，Al(CH3)3，用作含铝前体。来自气流源253的TMA，利用质量流量控制器258，通过气流分配装置240，将其脉冲输送到衬底210的表面。TMA被引至在HfCl4/水蒸气顺序进行过程中形成的二氧化铪薄膜上。
在程序块335内，第二吹洗气体被引入系统。对于TMA前体，纯净氩气用作吹洗气体和载气。来自吹洗气源262的氩气进入输气导管270，随后进入反应室220，其流量由质量流量控制器267控制。在经氩气吹洗之后，在程序块340内，将第二含氧前体脉冲输入反应室220。对于使用TMA作为前体的铝顺序，选用蒸馏水蒸气作为前体起氧化反应物作用，以便和位于衬底210上的TMA相互作用。来自气体源254的蒸馏水蒸气，利用质量控制器259，通过输气导管270将其脉冲输入反应室220。蒸馏水蒸气在衬底210的表面上发生积极的反应，从而形成HfAlO3薄膜。
在脉冲输送起氧化反应物作用的蒸馏水蒸气之后，在程序块345内，将第二吹洗气体喷射入反应室220。在TMA/蒸馏水蒸气顺序中，在脉冲输送每种前体气体之后，用氩气吹洗反应室。在另一实施方案中，纯净氮气重新用作吹洗气体。利用吹洗气体，清除掉系统中的剩余前体气体和反应副产物，同时利用真空泵282，通过质量流量控制器287，抽空反应室220，和利用真空泵281，通过质量流量控制器286，抽空输气导管270。这不仅完成了TMA/蒸馏水蒸气顺序，而且它还完成了铪顺序/铝顺序循环，从而形成了具有与一种ALD循环有关的设定厚度的HfAlO3层。
在进行TMA/蒸馏水蒸气顺序的过程中，通过加热元件230，使衬底温度保持为约350℃～约450℃。使反应室的温度保持为约150℃，以便使反应物凝结的可能性降至最低。使工艺压力在脉冲输送前体气体时保持为约230m托，而用于脉冲输送吹洗气体时保持为约200m托。用于TMA和蒸馏水蒸气二种前体的脉冲时间均约为1秒，而用于吹洗的脉冲时间约为15秒。在一种实施方案中，在完整的HfCl4/水蒸气/TMA/蒸馏水蒸气循环过程中，使衬底温度保持为约350℃。在另一实施方案中，在完整的HfCl4/水蒸气/TMA/蒸馏水蒸气循环过程中，使衬底温度保持为约550℃。
作为一种替代的铝顺序，可使用DMEAA/氧顺序而不是TMA/蒸馏水蒸气顺序。含铝前体DMEAA是一种铝烷(AlH3)和二甲基乙烷[N(CH3)2(C2H5)]的加合物。在程序块330内，来自气体源253的DMEAA气体被脉冲输送到衬底210表面上。通过将温度控制在25℃的气泡型蒸发作用向气体源253提供DMEAA气体。在程序块335内，与DMEAA有关的吹洗气体和载气是来自吹洗气体源262的氢。在程序块340内，为了在衬底210上产生必要的反应，来自气体源254的作为第二含氧前体的氧被脉冲输入反应室220。在程序块345内，来自吹洗气体源262的吹洗气体氢再次流过反应室220。
在进行DMEAA/氧顺序的过程中，利用加热元件230使衬底温度保持为约100℃～约125℃。在进行DMEAA/氧顺序的过程中，使工艺压力保持为约30m托。
在利用DMEAA替代铝顺序时，可在与TMA/蒸馏水顺序相同的温度和压力范围下使用DMEAA/蒸馏水蒸气顺序。在本发明的某一实施方案中，在完整的HfCl4/水蒸气/DMEAA/蒸馏水蒸气循环过程中使衬底温度保持为约350℃。另一方面，可在使衬底温度保持为约550℃的条件下，进行完整的HfCl4/水蒸气/DMEAA/蒸馏水蒸气循环。
在一个循环之后的HfAlO3薄膜的厚度，在已知温度下，由在铪顺序和铝顺序中所采用的脉冲周期确定。ALD方法的脉冲周期取决于所使用的反应系统200和前体以及吹洗气体源的特性。典型地，在给定温度下，脉冲周期可以在一个要比前体的最小脉冲时间长一些的较大范围内变化，但基本上没有改变生长速率。一旦一个循环的周期组被确定，那么HfAlO3薄膜的生长速率将被定为某一值例如Nnm/循环。例如在形成MOS晶体管的栅介质的应用中，为了使HfAlO3薄膜达到要求的厚度t，ALD方法应重复t/N次循环。
在程序块350内，要确定HfAlO3薄膜是否达到了要求的厚度t。正如所述，要求的厚度应在t/N次循环后完成。如果完成的循环次数小于t/N，本方法从脉冲输送含铪前体的程序块310处重新开始，在上面所讨论的实施方案中，这含铪前体就是HfCl4气体。如果t/N次循环已完成，不再进一步要求继续ALD作业，而在程序块355内，对HfAlO3薄膜进行退火。退火是生产HfAlO3薄膜的最后的加热循环，是在温度约300℃～800℃下进行的，以便生产出具有最佳性能的介质绝缘体。退火可以在惰性气氛或氮气气氛中进行。
在程序块360内，在形成HfAlO3薄膜之后，含HfAlO3薄膜的器件的加工便完成了。在一种实施方案中，完成这个器件包含完成晶体管的构成。另一方面，完成这方法包括完成存储器的构建，这存储器具有由HfAlO3薄膜栅介质形成的存取晶体管组成的阵列。再者，在另一实施方案中，完成这方法包括含有信息处理器的电子系统的形成，这信息处理器采用的电子器件使用了由HfAlO3薄膜栅介质形成的晶体管。典型地，信息处理器例如计算机包括许多存储器，这些存储器内装有许多存取晶体管。
在一种实施方案中，用作栅介质的HfAlO3薄膜是通过采用铪/水蒸气/铝/水蒸气循环的ALD方法使其形成在晶体管的本体区内。这循环是铪/水蒸气顺序和铝/水蒸气顺序的组合。在铪/水蒸气顺序结束时终止这循环将典型地导致形成HfO2薄膜。只进行铝/水顺序则典型地会导致形成Al2O3薄膜。
最近W.Zhu等人在第一届国际电子器件会议上发表的，刊登在会议论文集P.463～466(2001)上的论文，报导了利用喷射蒸汽沉积法形成的HfO2和HfAlO薄膜的生长。大约3nm厚的HfO2薄膜在400℃～500℃下似乎发生了晶化，而含有约6.8％ Al的HfAlO薄膜在比HfO2薄膜约高200℃的温度下发生晶化，含有约31.7％ Al的HfAlO薄膜则在比HfO2薄膜约高400℃的温度下发生晶化。因此，该论文指出HfAlO薄膜在较高温度下对其进行加工时往往导致形成结晶形结构。可是非晶形结构有利于用作栅介质。
最近J.Aarik等人在应用表面科学第173卷P.15～21(2001)上发表了一篇论文，报导了通过使用HfCl4/水蒸气顺序的ALD形成HfO2薄膜的生长。在衬底温度保持在从500℃到1000℃范围内的不同温度的情况下，HfCl4源的温度范围为130℃～154℃。对于衬底温度为940℃和水蒸气流速0.7mPa/m3的情况，已证实最终的薄膜结构取决于HfCl4源的温度。在HfCl4源温度为128℃时，薄膜是单斜晶系的，此时生长速率为0.034nm/循环，而在HfCl4源温度为152℃时，薄膜是立方晶系的，此时生长速率为0.067nm/循环。该报导断定，通过采用HfCl4和水蒸气的ALD生长成的HfO2薄膜的表面结构，当改变生长温度和前体剂量时，可以发生变化。
最近Y.Kim等人在应用物理通讯71(25)卷P.3604～3606(1997)页上发表的论文，报导了通过使用TMA/蒸馏水蒸气顺序的ALD形成Al2O3薄膜的生长。在衬底温度保持为370℃和TMA和蒸馏水蒸气的脉冲输送时间设定为各1秒的情况下，Al2O3薄膜的生长速率确定为每个循环约0.19nm。确定的这个生长速率对于TiN，Si，和SiO2衬底都是相同的。在最近由C.Jeong等人发表的刊登在日本应用物理杂志第40卷1部1章P.285～289页(2001)上的论文中，报导了利用ALD在100℃下Al2O3的生长速率为
Figure C03817714D00201
循环，此处一个循环为利用DMEAA作为前体进行五次Al沉积随后是O2等离子体氧化。典型地，由ALD形成的Al2O3薄膜是非晶形的。
含HfAlO3，Al2O3和HfO2的介质薄膜具有的介电常数在从Al2O3的介电常数9到HfO2的介电常数25的范围内。通过控制铪顺序的循环次数和铝顺序的循环次数，就能控制沉积在衬底表面区上的铪和铝的数量。因此，通过采用铪顺序和铝顺序的ALD所形成的介质薄膜可利用由含有选定或预定百分率的HfAlO3，Al2O3和HfO2组成的组合物制成，在这种情况下，这薄膜的有效介电常数将被选定或预定在9～25的范围内。此外，在铪顺序之后采用铝顺序，最后所得的含HfAlO3的介质应是非晶形的。
除了分别控制在ALD方法中的铪顺序和铝顺序的循环次数外，也可通过控制以下因素将含有HfAlO3的介质薄膜制造成具有选定的特性，即控制每个顺序所用的前体材料，每个顺序所采用的工艺温度和压力，各个前体的脉冲输送时间，以及在本方法的末尾，在每个循环的末尾和在每个顺序的末尾的热处理。热处理可包括在原位在各种环境包括在氩和氮环境中进行退火。
前体的脉冲输送时间范围为约0.5秒～约2至3秒，尽管可以使用较长的脉冲。典型地，吹洗气体的脉冲输送时间范围从等于与其相关的前体脉冲输送时间到数量级大于该相关前体脉冲输送时间，以便将所有剩余材料和副产物从反应系统中吹洗掉。通常吹洗气体的脉冲输送时间范围为约1秒～约30秒。在一种实施方案中，吹洗气体的脉冲输送时间范围为1～2秒。
所制成的含HfAlO3的薄膜的生长速率将受各个顺序的生长速率控制，而典型地可以是约
Figure C03817714D0021134126QIETU
/循环～约
Figure C03817714D0021134135QIETU
/循环。其它的生长速率也可获得。
在本发明的各种实施方案中可能得到的等效氧化物厚度teq的范围与形成具有介电常数为约9～约25的组合物的能力有关，和与达到实体薄膜厚度约2～约3nm和以上的能力有关。符合本发明的teq的范围示于下表：
Figure C03817714D00221
含HfAlO3的层其定标的下限将取决于形成全带隙所必须的薄膜的各单层，以使底层硅层和对着HfAlO3薄膜的上层导电层之间保持良好绝缘性。这一要求是避免底层硅层和上层导电层之间可能发生短路所必需的。根据上面所述，可明显看到可以实现使含HfAlO3的薄膜具有的teq为
Figure C03817714D0022134030QIETU
。再说，基本上没有界面层的薄膜可以达到的teq显著地小于2或
Figure C03817714D0022134023QIETU
甚至小于
Figure C03817714D0022134025QIETU
。
上面所述的利用铪顺序/铝顺序沉积循环进行原子层沉积的新颖方法具有很多优点。再者，通过独立地控制每个顺序的各个参数便可形成具有选定介电常数的栅介质。另外，提供的这新颖的方法可以用来形成各种晶体管，存储器和信息处理器。
图1中所描绘的晶体管100可以由形成在硅基衬底110中的源/漏区120和另一个源/漏区130构成，而这二个源/漏区120，130被主体区132隔开。源/漏120和源/漏130隔开的主体区132定义了具有沟道长度134的沟道。HfAlO3薄膜利用ALD方法形成，这ALD方法包括将含铪前体脉冲输入装有衬底110的反应室，将第一含氧前体脉冲输入反应室，将含铝前体脉冲输入反应室，以及将第二含氧前体脉冲输入反应室。每一种前体根据选定的时间周期被脉冲输入反应室。脉冲输送每一种前体所需时间的长短根据所采用的前体选定。在每次脉冲输送前体之间，将剩余前体和反应的副产物从反应室中去除。HfAlO3薄膜的厚度由重复进行脉冲输送含铪前体，第一含氧前体，含铝前体，和第二含氧前体的循环次数来控制，直到在主体区上形成要求厚度的含HfAlO3的薄膜140。栅形成在栅介质140的上方。典型地，形成栅包括形成多晶硅层，虽然在另外别的方法中可以形成金属栅。可采用本领域的那些技术人员周知的标准方法来形成衬底，源/漏区和栅。另外，用来形成晶体管的工艺各个单元的操作程序是按照对本领域的那些技术人员来说也是周知的标准制作程序进行的。
利用ALD形成用作栅介质的HfAlO3薄膜的方法的实施方案可以应用于其它的含有介质层的晶体管结构。例如，图4描绘了一种本发明所讲授的可以用来制作一种晶体管400构型的实施方案。晶体管400包括硅基衬底410和被主体区432隔开的二个源/漏区420，430。位于二个源/漏区420，430之间的主体区432定义了具有沟道长度434的沟道区。位于主体区432上方的是叠层455，它包括栅介质440，浮栅452，浮栅介质442，和控制栅450。栅介质440按照上述本发明所讲授的ALD方法形成，而晶体管400的其余单元采用本领域的那些技术人员熟知的方法形成。另一方面，栅介质440和浮栅介质442二者均可按照上述本发明所讲授的ALD方法形成。
采用上述方法产生的晶体管可以用于存储器和包含信息处理器的电子系统中。内含HfAlO3薄膜介质层的信息处理器可以采用上述方法的各种实施方案构成。这类信息处理器包括各种无线系统，电信系统和计算机。一种内含HfAlO3薄膜介质层的计算机实施方案示于图5～7并叙述如下。虽然下面所示的是特定形式的存储器和计算器件，但本领域的每一位技术人员都承认各个不同形式的存储器和和包含信息处理器的电子系统均可利用本发明。
个人用计算机如图5和图6所示，它包括监视器500，键盘输入502和中央处理机504。处理机部件504典型地包括微处理机606，存储器总线电路608，它含有许多存储器沟槽612(a～n)，和其它外围电路610。外围电路610允许各种外围器件624通过输入/输出(I/O)总线622与处理机/存储器总线620连接。图5和图6所示的个人用计算机还包括至少有一个这样的晶体管，它具有按照本发明所讲授的一种实施方案形成的含HfAlO3薄膜的栅介质。
微处理机606产生控制和地址信号，以便控制存储器总线电路608和微处理和606之间以及存储器总线电路608和外围电路610之间的数据交换。这种数据交换是通过高速存储器总线620和通过高速I/O总线622完成的。
许多存储器沟槽612(a～n)与存储器总线620耦合，这些沟槽能容纳对本领域的那些技术人员来说是众所周知的各种存储器。例如单列直插式存储模块(SIMM)和双列直插式存储模块(DIMM)可用于本发明的装置中。
这些存储器可根据各种不同的设计生产，这些设计提供不同的读出和写入存储器沟槽612的动态存储单元的方法。一种这样的方法是页面模式运行。DRAM中的页面模式运行由如下方法定义，存取一行存储单元阵列和随机地存取这阵列的不同的列。当存取该列的时候，储存在上述行和该列相交处的数据便可读出并输出。页面模式DRAM要求有一些限制存储器电路608通信速度的存取步骤。
一种替代型器件是扩充数据输出(EDO)型存储器，它使储存在存储器阵列地址处的数据，在寻址列已关闭之后仍可以有效输出。这种存储器由于允许较短的存取信号而增加了一些通信速度，但没有降低存储器输出数据在存储器总线620上有效的时间。其它别的类型的器件包括SDRAM，DDR SDRAM，SLDRAM和直接式RDRAM，以及其它的例如SRAM或快速存储器。
图7阐明了本发明所讲授的DRAM存储器700的实施方案的示意图。DRAM器件700是与存储器沟槽612(a～n)相容的。对DRAM 700的叙述已作了简化，为的是阐明DRAM存储器而不是用来全面叙述DRAM的所有特性。本领域的那些技术人员都承认各种各样的存储器均可用于本发明的装置中。图6所示的DRAM存储器实例包括至少有一个这样的晶体管，它具有按本发明所讲授的实施方案形成的HfAlO3薄膜的栅介质。
通过存储器总线620提供的控制，地址和数据信息由DRAM 700的各路输入进一步表示，正如图7所示。这些各路的表示由数据线702，地址线704和指向控制逻辑部件706的各条分立的线来阐明。
正如本领域内众所周知的，DRAM 700包括存储器阵列710，它本身包含行和列的可寻址存储器单元。同一行上的每个存储器单元与一条公用字线相耦合。这字线与各个晶体管的栅相耦合，此处至少有一个晶体管具与采用前面所述方法和结构形成的含HfAlO3的栅介质相耦合的栅。另外，在同一列上的每个存储器单元与一条公用位线相耦合。在存储器阵列710中的每个单元包括本领域内常见的存储电容器和存取晶体管。
例如，DRAM 700通过地址线704和数据线702与微处理机606相连接。另一方面，DRAM 700可以与DRAM控制器，微控制器，芯片装置或其它电子系统相连接。微处理机606还向DRAM 700提供许多控制信号，包括但不限于行和列地址选通信号RAS和CAS，写入启动信号WE，输出启动信号OE和其它常规控制信号。
行地址缓冲器712和行译码器714接收和译解来自行地址信号的行地址，这行地址信号由微处理机606经地址线704提供。每个唯一的行地址与存储器阵列710中的一行单元相对应。行译码器714包括字线驱动器，地址译码器树，和电路系统，这电路系统译出收到的来自行地址缓冲器712的给定行地址以及通过字线驱动器有选择地激活存储器阵列710的适合的字线。
列地址缓冲器716和列译码器718接收和译解通过地址线704提供的列地址信号。列译码器718还确定列何时发生了故障和确定置换列的地址。列译码器718与读出放大器720相耦合。读出放大器720与存储器阵列710的互补位线对相耦合。
读出放大器720与数据输入缓冲器722和数据输出缓冲器724相耦合。数据输入缓冲器722和数据输出缓冲器724均与数据线702相耦合。在写入运作过程中，数据线702向数据输入缓冲器722提供数据。读出放大器720接收来自数据输入缓冲器722的数据并将数据储存在存储器阵列710中，以电荷形式储存在地址线704上规定地址处的单元的电容中。
在读出运作过程中，DRAM 700将数据从存储器阵列710传输到微处理机606。在预充电运行期间使存取单元的互补位线平衡于基准电压，该基准电压由平衡电路和基准电压源提供。于是，储存在存取单元中的电荷与相关的位线分享。诸读出放大器720的一个读出放大器检测和放大互补位线之间的电压差。读出放大器将放大的电压传到数据输出缓冲器724。
控制逻辑部件706用来控制DRAM 700的许多有用的功能。此外，正如本领域的那些技术人员所熟知的那些用来启动DRAM 700并使DRAM 700运作保持同步的各种控制电路和信号在本文中没有详述。如上所述，已对DRAM 700的叙述作了简化，以便阐明本发明和没有打算完整叙述DRAM的所有性能。本领域的那些技术人员应认识，许多种存储器，包括但不限于，SDRAM，SLDRAM，RDRAM，和其它的DRAM和SRAM，VRAM和EEPROM，均可用于本发明的装置中。文中所描述的DRAM装置仅是为了说明，并没有排他或限制的意图。
结论
一种含HfAlO3的栅介质和一种制作这一类栅介质的方法生产出了一种可靠的栅介质，它具有的等效氧化物厚度比采用SiO2可能得到的要薄。
使用本文中所述方法形成的HfAlO3栅介质是热力稳定的，以致形成的栅介质在加工过程中与硅衬底或其它结构有极微弱的反应。
晶体管，高水平IC或器件，和系统是应用了形成超薄等效氧化物厚度teq的栅介质的新颖方法构成的。形成的含HfAlO3的栅介质层或薄膜具有高的介电常数(κ)，此处的栅介质的teq能够小于
Figure C03817714D0026133840QIETU
，小于SiO2栅介质的预定限制值。同时，HfAlO3层的实体厚度比与SiO2的teq限制值相关的SiO2厚度厚得多。形成较厚厚度有利于加工栅介质。此外，通过控制衬底的ALD加工过程中的铪顺序和铝顺序能使形成的含HfAlO3，Al2O3和HfO2的介质的介电常数可在Al2O3的介电常数到HfO2的介电常数范围内选择。
虽然在本文中已对一些具体的实施方案作了阐明和陈述，但本领域的那些普通技术人员都知道，任何以达到同样目的为目标的方案均可以代替所示的这些具体实施方案。本申请意图是包含本发明的任何修改或变更。可以认为上面的叙述是为了用来阐明的而不是限制的。在审阅上面陈述时，上述实施方案和其它的实施方案的组合对本领域的那些技术人员来说是显而易见的。本发明的范围包括其中采用了上述结构和制作方法的任何其它申请。本发明的范围应由附于后面的权利要求书，以及与该权利要求书所给予的范围等同的全范围来确定。

Claims (42)

1.一种形成电子器件的方法，它包含：
通过原子层沉积形成氧化铪铝层，其包括：
将含铪前体脉冲输入装有衬底的反应室，在含铪前体脉冲输送期间反应室基本上没有其它反应前体，含铪前体具有不含铝的组成；和
将含铝前体脉冲输入反应室，在含铝前体脉冲输送期间反应室基本上没有其它反应前体，含铝前体具有不含铪的组成，其中，脉冲输送含铪前体和脉冲输送含铝前体是在原子层沉积循环中进行的，从而形成氧化铪铝，并且在脉冲输送含铪前体后和在脉冲输送含铝前体后，反应室进行选自如下的过程：抽空反应室、用吹洗气体吹洗反应室以及抽空和吹洗反应室的结合。
2.权利要求1的方法，其中所述方法包括控制若干次的脉冲输送含铪前体的循环和若干次的脉冲输送含铝前体的循环以在氧化铪铝层中包括预定量的氧化铪。
3.权利要求1或2的方法，其中形成电子器件包括形成晶体管，这方法包括：
在衬底上形成第一和第二源/漏区，第一源/漏区和第二源/漏区被主体区分开；
将含铪前体脉冲输入反应室和将含铝前体脉冲输入以便在位于在第一和第二源/漏区之间的主体上形成介质薄膜；和
使栅与介质薄膜耦合。
4.权利要求1或2的方法，其中形成电子器件包括形成存储器，它至少有一个这样的存取晶体管，它在位于第一和第二源/漏区之间的主体区上有含HfAlO3的薄膜，其中形成这薄膜包括脉冲输送含铪前体和脉冲输送含铝前体。
5.权利要求4的方法，其中该方法包括
形成若干个存取晶体管；
形成若干条字线，它们与存取晶体管数目相同的若干个栅相耦合；
形成若干条源线，它们与存取晶体管数目相同的若干个第一源/漏区相耦合；
形成若干条位线，它们与存取晶体管数目相同的若干个第二源/漏区相耦合。
6.权利要求1或2的方法，其中形成电子器件包括形成电子系统，其包括：
提供处理机；
使存储器与处理机相耦合，其中存储器或处理机之一至少有一个这样的晶体管，它在位于第一和第二源/漏区之间的主体区上有含HfAlO3的薄膜，这种含HfAlO3的薄膜通过将含铪前体脉冲输入反应室和将含铝前体脉冲输入反应室的方法形成；和
形成系统总线，该总线使处理器与存储器阵列相耦合。
7.权利要求1，2，3，4或6的方法，其中将含铪前体脉冲输入反应室，随后将第一含氧前体脉冲输入反应室，然后将含铝前体脉冲输入反应室，接着将第二含氧前体脉冲输入反应室。
8.权利要求7的方法，其中脉冲输送第一含氧前体包括脉冲输送水蒸气。
9.权利要求7的方法，其中脉冲输送第二含氧前体包括脉冲输送蒸镏水蒸气。
10.权利要求7的方法，其中脉冲输送第二含氧前体包括脉冲输送氧。
11.权利要求1，2，3，4或6的方法，其中按照预定的周期对将每种前体脉冲输入反应室加以控制，预定的周期则根据被脉冲输入反应室的每种前体分别地加以确定。
12.权利要求1，2，3，4或6的方法，其中该方法包括，使衬底保持在根据每次脉冲输送的前体选定的温度下，这选定的温度根据脉冲输送的每种前体独立地设定。
13.权利要求1，2，3，4或6的方法，其中在每次脉冲输送前体之后，接着用吹洗气体吹洗反应室。
14.权利要求1，2，3，4或6的方法，其中该方法包括重复进行若干次脉冲输送含铪前体和含铝前体的循环。
15.权利要求14的方法，其中在重复进行若干次脉冲输送含铪前体和含铝前体循环之后，接着在300℃～800℃的温度下进行退火处理。
16.权利要求1，2，3，4或6的方法，其中该方法包括独立地控制每种前体的脉冲周期的时间，被脉冲输送到衬底上的前体的次数，和衬底的温度，以便形成含HfAlO3的介质薄膜，这介质薄膜具有的介电常数为9～25。
17.权利要求16的方法，其中形成含HfAlO3的介质薄膜包括形成一种基本上是HfAlO3的薄膜。
18.权利要求1，2，3，4或6的方法，其中脉冲输送含铪前体包括脉冲输送HfCl4前体。
19.权利要求18的方法，其中将HfCl4前体脉冲输入反应室是在使衬底的温度保持在350℃～550℃的条件下进行的。
20.权利要求18的方法，其中将HfCl4前体脉冲输入反应室是在HfCl4前体的温度为130℃～154℃的条件下进行的。
21.权利要求18的方法，其中该方法包括在脉冲输送HfCl4前体之后，以0.5mPam3/秒～1.0mPam3/秒的流速将第一含氧前体脉冲输入反应室。
22.权利要求1，2，3，4或6的方法，其中脉冲输送含铝前体包括将三甲基铝前体脉冲输入反应室。
23.权利要求22的方法，其中将三甲基铝前体脉冲输入反应室是在使衬底温度保持在350℃～370℃的条件下进行的。
24.权利要求22的方法，其中将三甲基铝前体脉冲输入反应室是在压力为230m托的条件下进行的。
25.权利要求1，2，3，4或6的方法，其中脉冲输送含铝前体包括将DMEAA前体脉冲输入反应室。
26.权利要求25的方法，其中将DMEAA前体脉冲输入反应室是在使衬底温度保持在350℃～550℃的条件下进行的。
27.权利要求25的方法，其中将DMEAA前体脉冲输入反应室是在压力为30m托的条件下进行的。
28.权利要求1，2，3，4或6的方法，其中脉冲输送含铪前体包括脉冲输送HfCl4前体入反应室而脉冲输送含铝前体包括将三甲基铝前体脉冲输入反应室。
29.权利要求28的方法，其中在将三甲基铝前体脉冲输入反应室之后，接着用氩气吹洗反应室。
30.权利要求1，2，3，4或6的方法，其中脉冲输送含铪前体包括脉冲输送HfCl4前体入反应室和脉冲输送含铝前体包括将DMEAA前体脉冲输入反应室。
31.权利要求28的方法，其中在将HfCl4前体脉冲输入反应室之后，接着用纯净氮气吹洗反应室。
32.权利要求30的方法，其中在将DMEAA前体脉冲输入反应室之后，接着用氢气吹洗反应室。
33.一种用权利要求1，2，3，4，6，18，22，25，28或30的方法形成的电子器件。
34.一种电子器件，它包含：
至少一个晶体管，它具有位于第一和第二源/漏区之间的主体区，在主体区上的介质薄膜，和与该介质薄膜相耦合的栅；
其特征在于
介质薄膜含有原子层沉积型HfAlO3。
35.权利要求34的电子器件，其中这电子器件是存储器。
36.权利要求35的电子器件，其中这存储器包括：
若干个存取晶体管；
若干条字线，它们与存取晶体管数目相同的若干个栅相耦合；
若干条源线，它们与存取晶体管数目相同的若干个第一源/漏区相耦合；
若干条位线，它们与存取晶体管数目相同的若干个第二源/漏区相耦合。
37.权利要求34的电子器件，其中这电子器件是具有与存储器相耦合的处理机的电子系统。
38.权利要求34，35或37的电子器件，其中介质薄膜包括Al2O3和HfO2。
39.权利要求34，35或37的电子器件，其中介质薄膜基本上是非晶形的。
40.权利要求34，35或37的电子器件，其中介质薄膜具有的介电常数为9～25。
41.权利要求34，35或37的电子器件，其中介质薄膜具有的等效氧化物厚度(teq)为3埃～12埃。
42.权利要求34，35或37的电子器件，其中介质薄膜具有的等效氧化物厚度(teq)小于3埃。
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